A 56Gb/s Long Reach Fully Adaptive Wireline PAM-4 Transceiver in 7nm FinFET

A 56Gb/s Long Reach Fully Adaptive Wireline PAM-4 Transceiver in 7nm FinFET
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采用 7nm FinFET 的 56Gb/s 长距离完全自适应有线 PAM-4 收发器

DOI:
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发表时间:
2019
期刊:
Symposium on VLSI Circuits
影响因子:
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通讯作者:
K. Hsieh
K. Hsieh
中科院分区:
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文献类型:
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作者:
D. Pfaff;Shahaboddin Moazzeni;L. Gao;Mei;Xin;Chai Palusa;R. Abbott;Rolando Ramirez;Maher Amer;Ming;Chih;F. Kuo;Wei;Tae Young Goh;K. Hsieh

文献摘要

被引文献

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这款 56Gb/s PAM-4 收发器通过严格应用数字设计风格,利用 7nm FinFET 技术提供的高逻辑密度:全数字 PLL 和 SST 发送器与 28GS/s 8b ADC 和 DSP 接收器相结合,模拟信号处理仅限于两级前端。该接收器实现了原始 1e-7 BER 和 33dB 插入损耗通道,同时功耗为 500mW,包括配备 DSP 部分的 20 抽头 FFE 和 1 抽头 DFE。
This 56Gb/s PAM-4 transceiver leverages the high logic density provided by the 7nm FinFET technology through rigorous application of digital design styles: An All-Digital PLL and SST transmitter are combined with a 28GS/s 8b ADC and DSP receiver, with the analog signal processing limited to a two stage front-end. The receiver achieves a raw 1e-7 BER with a-33dB insertion loss channel while consuming 500mW, including the 20-tap FFE and 1-tap DFE equipped DSP section.