岡田健一, 小野寺秀俊: "ゲート遅延におけるチップ内ばらつきを考慮した統計遅延解析手法"電子情報通信学会回路とシステム(軽井沢)ワークショップ. 499-504 (2002)
岡田健一, 小野寺秀俊: "ゲート遅延におけるチップ内ばらつきを考慮した統計遅延解析手法"電子情報通信学会回路とシステム(軽井沢)ワークショップ. 499-504 (2002)
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Kenichi Okada、Hidetoshi Onodera：“考虑门延迟芯片内变化的统计延迟分析方法”IEICE 电路与系统（轻井泽）研讨会 499-504 (2002)。
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