平田 博章: "マルチスレッドプロセッサおよび1チップマルチプロセッサのための命令キャッシュ構成・命令フェッチ方式の性能評価"電子情報通信学会・論文誌. J81-D-I,5. 718-727 (1998)
平田 博章: "マルチスレッドプロセッサおよび1チップマルチプロセッサのための命令キャッシュ構成・命令フェッチ方式の性能評価"電子情報通信学会・論文誌. J81-D-I,5. 718-727 (1998)
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Hiroaki Hirata：“多线程处理器和单芯片多处理器的指令高速缓存配置和指令获取方法的性能评估”IEICE J81-D-I，5. 718-727 (1998)。
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