A High-speed Trace-driven Cache Configuration Simulator for Dual-core Processor L1 Caches
A High-speed Trace-driven Cache Configuration Simulator for Dual-core Processor L1 Caches
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用于双核处理器 L1 高速缓存的高速跟踪驱动的高速缓存配置模拟器
DOI：
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发表时间：
2013
期刊：
影响因子：
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通讯作者：
Nozomu Togawa
中科院分区：
文献类型：
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作者：
Masashi Tawada;Masao Yanagisawa;Nozomu Togawa
