A Processor Architecture Integrating Voltage Scalable On-Chip Memories for Individual Tracking of Minimum Energy Points in Logic and Memory
A Processor Architecture Integrating Voltage Scalable On-Chip Memories for Individual Tracking of Minimum Energy Points in Logic and Memory
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集成电压可扩展片上存储器的处理器架构，用于单独跟踪逻辑和存储器中的最小能量点
DOI：
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发表时间：
2016
期刊：
影响因子：
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通讯作者：
Hidetoshi Onodera
中科院分区：
文献类型：
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作者：
Jun Shiomi;Tohru Ishihara;Hidetoshi Onodera
