Kazuya Ishida: "Design and Verification of Parallel Multipliers Using Arithmetic Description Language : ARITH"Proceedings of the 34rd IEEE International Symposium on Multiple-Valued Logic. (採録決定). (2004)
Kazuya Ishida: "Design and Verification of Parallel Multipliers Using Arithmetic Description Language : ARITH"Proceedings of the 34rd IEEE International Symposium on Multiple-Valued Logic. (採録決定). (2004)
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Kazuya Ishida：“使用算术描述语言的并行乘法器的设计和验证：ARITH”第 34 届 IEEE 国际多值逻辑研讨会论文集（已接受）。
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