Takenori Kouda: "Reduction of the Number of FPGA Blocks by Maximizing Flexibility of Intrenal Functions" IEICE Trans, Special Section on VLSI Design and CAD Algorithm. 2554-2562 (1998)
Takenori Kouda: "Reduction of the Number of FPGA Blocks by Maximizing Flexibility of Intrenal Functions" IEICE Trans, Special Section on VLSI Design and CAD Algorithm. 2554-2562 (1998)
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Takenori Kouda：“通过最大化内部功能的灵活性来减少 FPGA 模块的数量”IEICE Trans，VLSI 设计和 CAD 算法的特别章节。
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