Research for secure processors based on the microarchitectural state modeling
Research for secure processors based on the microarchitectural state modeling
基于微体系结构状态建模的安全处理器研究
批准号：
19K20235
负责人：
TANIMOTO TERUO
金额：
$2.66万
依托单位：
依托单位国家：
日本
项目类别：
Grant-in-Aid for Early-Career Scientists
财政年份：
2019
资助国家：
日本
项目状态：
已结题
起止时间：
2019-04-01 至 2022-03-31
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Hardware-based malware detection for IoT microprocessors
针对物联网微处理器的基于硬件的恶意软件检测
针对物联网微处理器的基于硬件的恶意软件检测
DOI：
--
发表时间：
2020
期刊：
影响因子：
--
作者：
[Shunsuke Tsukada, Masayuki Sato Kazuhiko Komatsu, Hiroaki Kobayashi, Keisuke Yano, Teruo Tanimoto]
通讯作者：
Teruo Tanimoto
Halideを用いたオイラー動画像誇張処理のCPU-FPGAハイブリッドシステムの設計と実装
Halide用于Euler视频夸张处理的CPU-FPGA混合系统的设计与实现
Halide用于Euler视频夸张处理的CPU-FPGA混合系统的设计与实现
DOI：
--
发表时间：
2021
期刊：
影响因子：
--
作者：
[上野 麟, 谷本 輝夫, 後藤 孝行, 丸岡 晃, 川上 哲志, 小野 貴継, 飯塚 拓郎, 井上 弘士]
通讯作者：
井上 弘士
プロセッサへの実装に向けたORAMにおけるポジションマップ削減手法の検討
ORAM中位置图缩减方法在处理器中实现的考虑
ORAM中位置图缩减方法在处理器中实现的考虑
DOI：
--
发表时间：
2021
期刊：
影响因子：
--
作者：
[山方大輔, 川上哲志, 谷本輝夫, 井上弘士, 小野貴継]
通讯作者：
小野貴継
オイラー動画像誇張処理を対象としたCPU-FPGAハイブリッドシステムの実装と評価
用于欧拉视频夸张处理的 CPU-FPGA 混合系统的实现和评估
用于欧拉视频夸张处理的 CPU-FPGA 混合系统的实现和评估
DOI：
--
发表时间：
2021
期刊：
影响因子：
--
作者：
[上野麟, 谷本輝夫, 後藤孝行, 丸岡晃, 川上哲志, 小野貴継, 飯塚拓郎, 井上弘士]
通讯作者：
井上弘士
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