Synthesizable Mixed-Signal Integrated Circuits for Agile Development of Analog AI Sensor Nodes

用于敏捷开发模拟 AI 传感器节点的可合成混合信号集成电路

基本信息

  • 批准号：
    20K14786
  • 负责人：
    Xu Zule
  • 金额：
    $ 2.66万
  • 依托单位：
    The University of Tokyo
  • 依托单位国家：
    日本
  • 项目类别：
    Grant-in-Aid for Early-Career Scientists
  • 财政年份：
    2020
  • 资助国家：
    日本
  • 起止时间：
    2020-04-01 至 2022-03-31
  • 项目状态：
    已结题

项目摘要

项目成果

期刊论文数量（11）
专著数量（0）
科研奖励数量（0）
会议论文数量（0）
专利数量（0）
Analysis and simulation of MOSFET-based gate-voltage-independent capacitor
基于MOSFET的栅压无关电容器的分析与仿真
Low-Power and Low-Noise Clock Generation: A Fractional-N Hybrid CDAC-Embedded Sampling PLL and a Class-C Complementary Colpitts Crystal Oscillator
低功耗和低噪声时钟生成：分数 N 混合 CDAC 嵌入式采样 PLL 和 C 类互补 Colpitts 晶体振荡器
  • DOI：
  • 发表时间：
    2021
  • 期刊：
  • 影响因子：
    0
  • 作者：
    Terutsuki Daigo;Mitsuno Hidefumi;Kanzaki Ryohei;Z. Xu
  • 通讯作者：
    Z. Xu
A 10-GHz Inductorless Cascaded PLL with Zero-ISF Subsampling Phase Detector Achieving -63-dBc Reference Spur, 175-fs RMS Jitter and -240-dB FOMjitter
具有零 ISF 二次采样鉴相器的 10GHz 无电感级联 PLL，可实现 -63dBc 参考杂散、175fs RMS 抖动和 -240dB FOM 抖动
  • DOI：
  • 发表时间：
    2022
  • 期刊：
  • 影响因子：
    0
  • 作者：
    Z. Yang;Z. Xu;M. Osada;and T. Iizuka
  • 通讯作者：
    and T. Iizuka
A fractional-N MASH2-k FDC phase-locked loop architecture enabling higher-order quantisation noise shaping
小数 N MASH2-k FDC 锁相环架构可实现高阶量化噪声整形
  • DOI：
    10.1049/ell2.12436
  • 发表时间：
    2022
  • 期刊：
    IET Electronics Letters
  • 影响因子：
    0
  • 作者：
    R. Iwashita;Z.Xu;M. Osada;and T. Iizuka
  • 通讯作者：
    and T. Iizuka
A 0.79-1.16-GHz Synthesizable Fractional-N PLL Using DTC-Based Multi-Stage Injection with Dithering-Assisted Local Skew Calibration Achieving －232.8-dB FoMref
0.79-1.16GHz 可合成小数 N PLL，使用基于 DTC 的多级注入和抖动辅助本地偏斜校准，实现 -232.8dB FoMref
  • DOI：
  • 发表时间：
    2021
  • 期刊：
  • 影响因子：
    0
  • 作者：
    S. Sosumi;K. Shimoyoshi;K. Uchida;and T. Tajiri;Z. Xu
  • 通讯作者：
    Z. Xu
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Xu Zule其他文献

A 3.2-to-3.8 GHz Harmonic-Mixer-Based Dual-Feedback Fractional-N PLL Achieving -65 dBc In-Band Fractional Spur
基于 3.2 至 3.8 GHz 谐波混频器的双反馈小数 N PLL 实现 -65 dBc 带内小数杂散
  • DOI：
    10.1109/lssc.2020.3037311
  • 发表时间：
    2020
  • 期刊：
    IEEE Solid-State Circuits Letters
  • 影响因子：
    2.7
  • 作者：
    Osada Masaru;Xu Zule;Iizuka Tetsuya
  • 通讯作者：
    Iizuka Tetsuya
Analysis of Offset Spurs in Phase-Locked-Loops Employing Harmonic-Mixer-Based Feedback With Sample-and-Hold Operation
采用基于谐波混频器的反馈和采样保持操作的锁相环中的偏移杂散分析

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  • DOI：
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  • 发表时间：
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  • 期刊：
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  • 作者：
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  • 通讯作者：
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Research on Ultra-Low Power Ring-Oscillator Based Frequency Synthesizer for Wireless Sensor Nodes
基于超低功耗环形振荡器的无线传感器节点频率合成器研究
  • 批准号：
    17K14684
  • 财政年份：
    2017
  • 资助金额：
    $ 2.66万
  • 项目类别：
    Grant-in-Aid for Young Scientists (B)
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