ルック・アップ・テーブル・リングの論理合成

查找表环的逻辑综合

基本信息

  • 批准号:
    16650013
  • 负责人:
  • 金额:
    $ 1.98万
  • 依托单位:
  • 依托单位国家:
    日本
  • 项目类别:
    Grant-in-Aid for Exploratory Research
  • 财政年份:
    2004
  • 资助国家:
    日本
  • 起止时间:
    2004 至 2005
  • 项目状态:
    已结题

项目摘要

1.高速論理シミュレータの開発LUT(Look-Up Table)カスケード・エミュレータを用いたサイクルベース形式論理シミュレータを開発した.LUTカスケード・エミュレータとは,複数のLUT(セル)を直列に接続したLUTカスケードを模擬するアーキテクチャである.LUTカスケード・エミュレータは制御部とメモリとレジスタを持ち,書き換え可能な接続回路でメモリと各レジスタの接続を行い,メモリのアドレスを計算する.そして,メモリに格納したセルを読み出す.以上を繰り返して論理回路を評価する.本手法は,LUTカスケード・エミュレータを汎用のPC上でソフトウェアを用いて実現する.Levelized Compiled Code(LCC)と比較して,本手法のシミュレーション実行時間は3.5〜10.6倍高速であり,シミュレーション準備時間は2.0〜9.8倍高速である.また,QRMDD(Quasi-Reduced Multi-valued Decision Diagram)と比較して,シミュレーション準備時間は若干早く,必要メモリ量は1/2.9〜1/3.6であり,シミュレーション実行時間は1.1〜3.9倍高速であった.本研究成果を横浜で開催された国際会議ASPDAC-2006で発表した.本シミュレータは,専用のハードウエアを必要とせず,安価な汎用パソコン上で動作するため,極めて実際的であり,評判が良かった.本研究に関しては,従来から新しいアーキテクチャーを作成して何年も研究勢力を注いできたが,本成果が最も評判が良かった.なお、本方式は,従来,「ルック・アップ・テーブル・リング」と呼んでいたが、研究が進むにつれ,「ルック・アップ・テーブル・カスケード・エミュレータ」(LUTカスケード・エミュレータ)と呼んだほうが適当ということが明らかになったため,本報告書では,「LUTカスケード・エミュレータ」という用語を用いている.
1. High-speed reasoning シ, シ, ュレ, ュレ, タ <s:1> develop LUT(Look Up Table) カ ス ケ ー ド · エ ミ ュ レ ー タ を with い た サ イ ク ル ベ ー ス form logical シ ミ ュ レ ー タ を open 発 し た. LUT カ ス ケ ー ド · エ ミ ュ レ ー タ と は, plural の LUT (セ ル) を inline に meet 続 し た LUT カ ス ケ ー ド を simulation す る ア ー キ テ ク チ ャ で あ る. LUT カ ス ケ ー ド · エ ミ ュ レ ー タ は suppression of と メ モ リ と レ ジ ス タ を ち to have, change book き え may な 続 loop で メ モ リ と each レ ジ ス タ の meet 続 を い, メ モ リ の ア ド レ ス を computing す る. そ し て, メ モ リ に Wagner し た セ ル を 読 み す. Above を Qiao り return し て logical loop を review 価 す る. This technique は, LUT カ ス ケ ー ド · エ ミ ュ レ ー タ を domestic の PC で ソ フ ト ウ ェ ア を with い て be presently す る. Levelized Compiled Code (LCC) と comparative し て, this technique の シ ミ ュ レ ー シ ョ ン line be time は 3.5 ~ 10.6 times the で あ り, シ ミ ュ レ ー シ ョ ン preparation time は 2.0 ~ 9.8 times the で あ る. ま た, QRMDD (Quasi - Reduced Multi - valued Decision Diagram) と comparative し て, シ ミ ュ レ ー シ ョ ン preparation time は く several early, necessary メ モ リ quantity は 1/2.9 ~ 1/3.6 で あ り, シ ミ ュ レ ー シ ョ ン line be time は 1.1 ~ 3.9 times the で あ っ た. The research results of this study を yokohama で initiated された international conference ASPDAC-2006で presented た た. This シ ミ ュ レ ー タ は, 専 with の ハ ー ド ウ エ ア を necessary と せ ず, Ann 価 な domestic パ ソ コ ン で action on す る た め, extremely め て be interstate で あ り, good judgment が か っ た. This study に masato し て は 従 to か ら new し い ア ー キ テ ク チ ャ ー を made し て when も research forces を note い で き た が, this results が も most good judge が か っ た. な お, this way は 従, "ル ッ ク · ア ッ プ · テ ー ブ ル · リ ン グ" と shout ん で い た が が, research into む に つ れ, "ル ッ ク · ア ッ プ · テ ー ブ ル · カ ス ケ ー ド · エ ミ ュ レ ー タ "(LUT カ ス ケ ー ド · エ ミ ュ レ ー タ) と shout ん だ ほ う が appropriate と い う こ と が Ming ら か に な っ た た め, this report で は," LUT カ ス ケ ー ド · エ ミ ュ レ ー タ "と い う language を with い て い る.

项目成果

期刊论文数量(20)
专著数量(0)
科研奖励数量(0)
会议论文数量(0)
专利数量(0)
A design algorithm for sequential circuits using LUT rings
使用LUT环的时序电路设计算法
A Realization of Multiple-Output Functions by a Look-Up Table Ring
Area-time complexities of multi-valued decision diagrams
多值决策图的面积时间复杂度
On the optimization of heterogeneous MDDs
异构MDD的优化
Unified algorithm to generate Walsh functions in four different orderings and its programmable hardware implementation
四种不同顺序生成沃尔什函数的统一算法及其可编程硬件实现
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  • 发表时间:
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  • 期刊:
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  • 作者:
    島田健市;福士将;堀口進;渡邉 寛;菅原 雅也;福士 将;福士 将;堀口 進;Takahiro Uchiya;Takahiro Uchiya;打矢隆弘;石井貴光;打矢隆弘;打矢隆弘;吉永純也;吉永純也;打矢隆弘;Takahiro Uchiya;角田 裕;和泉勇治;角田 裕;角田 裕;和泉 勇治;Hiroshi Tsunoda;角田 裕;角田 裕;笹尾 勤;永山 忍;永山 忍
  • 通讯作者:
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  • 发表时间:
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  • 影响因子:
    0
  • 作者:
    島田健市;福士将;堀口進;渡邉 寛;菅原 雅也;福士 将;福士 将;堀口 進;Takahiro Uchiya;Takahiro Uchiya;打矢隆弘;石井貴光;打矢隆弘;打矢隆弘;吉永純也;吉永純也;打矢隆弘;Takahiro Uchiya;角田 裕;和泉勇治;角田 裕;角田 裕;和泉 勇治;Hiroshi Tsunoda;角田 裕;角田 裕;笹尾 勤;永山 忍;永山 忍;永山 忍
  • 通讯作者:
    永山 忍
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知道了