Robust ultra-low voltage LSI design technology

稳健的超低压LSI设计技术

基本信息

  • 批准号：
    15K06036
  • 负责人：
    Yanagisawa Masao
  • 金额：
    $ 3.16万
  • 依托单位：
    Waseda University
  • 依托单位国家：
    日本
  • 项目类别：
    Grant-in-Aid for Scientific Research (C)
  • 财政年份：
    2015
  • 资助国家：
    日本
  • 起止时间：
    2015-04-01 至 2018-03-31
  • 项目状态：
    已结题

项目摘要

项目成果

期刊论文数量（0）
专著数量（0）
科研奖励数量（0）
会议论文数量（0）
专利数量（0）
15nmプロセスにおける低電力な耐ソフトエラーラッチの設計
15nm工艺低功耗抗软错误锁存器设计
  • DOI：
  • 发表时间：
    2015
  • 期刊：
  • 影响因子：
    0
  • 作者：
    田島咲季;史又華;戸川望;柳澤政生
  • 通讯作者：
    柳澤政生
高速かつ低電力なソフトエラー耐性をもつFast-SEHラッチの設計
高速、低功耗、软容错的Fast-SEH锁存器设计
  • DOI：
  • 发表时间：
    2016
  • 期刊：
  • 影响因子：
    0
  • 作者：
    田島咲季;史又華;戸川望;柳澤政生
  • 通讯作者：
    柳澤政生
Soft error tolerant latch designs with low power consumption
低功耗软容错锁存器设计
  • DOI：
  • 发表时间：
    2017
  • 期刊：
  • 影响因子：
    0
  • 作者：
    Saki Tajima;Nozomu Togawa;Masao Yanagisawa;and Youhua Shi
  • 通讯作者：
    and Youhua Shi
C-element を用いたソフトエラー耐性をもつSHCラッチの設計
使用 C 元素设计具有软容错功能的 SHC 锁存器
  • DOI：
  • 发表时间：
    2017
  • 期刊：
  • 影响因子：
    0
  • 作者：
    田島咲季;史又華;戸川望;柳澤政生
  • 通讯作者：
    柳澤政生
A low-power soft error tolerant latch scheme
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Yanagisawa Masao其他文献

A Floorplan-aware High-level Synthesis Algorithm Utilizing Interconnection Delay Characteristics in FPGA Designs
一种利用 FPGA 设计中互连延迟特性的布局感知高级综合算法
  • DOI：
  • 发表时间：
    2014
  • 期刊：
  • 影响因子：
    0
  • 作者：
    Fujiwara Koichi;Yanagisawa Masao;T. Nozomu
  • 通讯作者：
    T. Nozomu
Scalable Stochastic Number Duplicators for Accuracy-flexible Arithmetic Circuit Design
用于精度灵活的算术电路设计的可扩展随机数复制器

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Robust LSI design technology against invasion
抵御入侵的鲁棒LSI设计技术
  • 批准号：
    19K11886
  • 财政年份：
    2019
  • 资助金额：
    $ 3.16万
  • 项目类别：
    Grant-in-Aid for Scientific Research (C)
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作者：{{ showInfoDetail.author }}

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