サイドチャネル攻撃に高い耐性を持つマルチコアIoTデバイスのソフトウェア基盤
サイドチャネル攻撃に高い耐性を持つマルチコアIoTデバイスのソフトウェア基盤
批准号:
22K21276
负责人:
西川 広記
金额:
$1.83万
依托单位:
依托单位国家:
日本
项目类别:
Grant-in-Aid for Research Activity Start-up
财政年份:
2022
资助国家:
日本
项目状态:
已结题
起止时间:
2022-08-31 至 2024-03-31
中文摘要
本年度は、シングルコアのハードウェアセキュリティ攻撃評価用ボードを用いて、暗号処理における命令をシャッフルし、暗号処理をランダムにスケジューリングする手法を開発した。AESに代表される暗号処理に対して開発されたスケジューリング手法を適用し、ハードウェアセキュリティ攻撃のなかでも最も安価かつ脅威であるとして知られる電力解析攻撃を行った。本年度は、そのセキュリティ攻撃耐性の向上を確認して、本手法の有効性を確認するまでを実施した。本研究は暗号処理をランダムにスケジューリングし、かつ、並列処理を行うことでプロセッサやメモリから漏えいするサイドチャネル情報を隠匿し、ハードウェアセキュリティ攻撃に対する耐性を高める狙いがある。まず本年度では、暗号処理のランダムスケジューリングによって暗号処理における実行時の消費電力におけるエントロピーを増大させ、攻撃者が不正に取得したサイドチャネル情報からの暗号鍵解析を困難にするための手法の開発を行った。開発されたスケジューリング手法は、一般的な単純電力解析や差分電力解析、相関電力解析において、最大で60%以上の攻撃耐性向上を確認した。しかしながら、近年の深層学習を利用したサイドチャネル攻撃に対して、依然として脆弱であることが予想される。したがって、次年度は深層学習を適用したサイドチャネル攻撃耐性の評価に加え、並列処理を利用したさらなるセキュリティ攻撃耐性の向上を図る。
英文摘要
本年度は、シングルコアのハードウェアセキュリティ攻撃評価用ボードを用いて、暗号処理における命令をシャッフルし、暗号処理をランダムにスケジューリングする手法を開発した。AESに代表される暗号処理に対して開発されたスケジューリング手法を適用し、ハードウェアセキュリティ攻撃のなかでも最も安価かつ脅威であるとして知られる電力解析攻撃を行った。本年度は、そのセキュリティ攻撃耐性の向上を確認して、本手法の有効性を確認するまでを実施した。本研究は暗号処理をランダムにスケジューリングし、かつ、並列処理を行うことでプロセッサやメモリから漏えいするサイドチャネル情報を隠匿し、ハードウェアセキュリティ攻撃に対する耐性を高める狙いがある。まず本年度では、暗号処理のランダムスケジューリングによって暗号処理における実行時の消費電力におけるエントロピーを増大させ、攻撃者が不正に取得したサイドチャネル情報からの暗号鍵解析を困難にするための手法の開発を行った。開発されたスケジューリング手法は、一般的な単純電力解析や差分電力解析、相関電力解析において、最大で60%以上の攻撃耐性向上を確認した。しかしながら、近年の深層学習を利用したサイドチャネル攻撃に対して、依然として脆弱であることが予想される。したがって、次年度は深層学習を適用したサイドチャネル攻撃耐性の評価に加え、並列処理を利用したさらなるセキュリティ攻撃耐性の向上を図る。
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DOI:
10.1109/candarw57323.2022.00042
发表时间:
2022-11
期刊:
2022 Tenth International Symposium on Computing and Networking Workshops (CANDARW)
影响因子:
--
作者:
[Eiji Sugahara;Hiroki Nishikawa;Xiangbo Kong;Hiroyuki Tomiyama]
通讯作者:
Eiji Sugahara;Hiroki Nishikawa;Xiangbo Kong;Hiroyuki Tomiyama
Empirical Analysis of Side-Channel Attack Resistance of HLS-Designed AES Circuits,
HLS 设计的 AES 电路抗侧信道攻击的实证分析,
DOI:
--
发表时间:
2022
期刊:
影响因子:
--
作者:
[Takumi Mizuno, Hiroki Nishikawa, Xiangbo Kong, Hiroyuki Tomiyama,]
通讯作者:
Hiroyuki Tomiyama,
Impacts of Clock Constraints on Side-Channel Leakage of HLS-Designed AES Circuits
时钟约束对 HLS 设计的 AES 电路的侧通道泄漏的影响
DOI:
--
发表时间:
2022
期刊:
影响因子:
--
作者:
[Yuto Miura, Takumi Mizuno, Hiroki Nishikawa, Xiangbo Kong, Hiroyuki Tomiyama]
通讯作者:
Hiroyuki Tomiyama
Side Channel Power Analysis Resistance Evaluation of Masked Adders on FPGA
FPGA 上屏蔽加法器的侧通道功率分析电阻评估
DOI:
10.11591/ijres.v12.i1.pp97-112
发表时间:
2023
期刊:
International Journal of Reconfigurable and Embedded Systems
影响因子:
--
作者:
[Yilin Zhao, Hiroki Nishikawa, Xiangbo Kong, Hiroyuki Tomiyama]
通讯作者:
Hiroyuki Tomiyama
Design of Federated Learning Framework as Computer Systems
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批准号:23K16858
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项目类别:Grant-in-Aid for Early-Career Scientists
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资助金额:$2.83万
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财政年份:2023
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负责人:西川 広記
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依托单位:
Task Scheduling on Multiple- and Many-cores
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批准号:20J21208
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项目类别:Grant-in-Aid for JSPS Fellows
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资助金额:$1.98万
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财政年份:2020
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负责人:西川 広記
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依托单位:
海外基金