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Robust Buffer and Wire Sizing for Modern Clock Networks in Integrated Circuits

Robust Buffer and Wire Sizing for Modern Clock Networks in Integrated Circuits
集成电路中现代时钟网络的稳健缓冲器和线径调整
批准号：
442936-2013
负责人：
Farshidi, Amin
金额：
$2.55万
依托单位：
University of Calgary
依托单位国家：
加拿大
项目类别：
Alexander Graham Bell Canada Graduate Scholarships - Doctoral
财政年份：
2014
资助国家：
加拿大
项目状态：
已结题
起止时间：
2014-01-01 至 2015-12-31
来源：
https://www.nserc-crsng.gc.ca/ase-oro/Details-Detailles_eng.asp?id=553687
关键词：
RobustBufferWireSizingModern

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Integrated circuits, Physical design, Clock network, Buffer sizing, Wire sizing, Robust optimization, Geometric programming, Process variation, Design for manufacturability, Computer-aided design
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Robust Buffer and Wire Sizing for Modern Clock Networks in Integrated Circuits
  • 批准号：
    442936-2013
  • 项目类别：
    Alexander Graham Bell Canada Graduate Scholarships - Doctoral
  • 资助金额：
    $2.55万
  • 财政年份：
    2013
  • 负责人：
    Farshidi, Amin
  • 依托单位：
    University of Calgary
国内基金
海外基金
建筑工程计划中Time Buffer 的形成和分配 – 工程项目管理中的社会性研究
  • 批准号：
    71671098
  • 项目类别：
    面上项目
  • 资助金额：
    48.0万元
  • 批准年份：
    2016
  • 负责人：
    刘敏
  • 依托单位：
    青岛理工大学