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Flexible, Dynamische rekonfigurierbare Verarbeitungspfade in Netzwerkprozessoren

Flexible, Dynamische rekonfigurierbare Verarbeitungspfade in Netzwerkprozessoren
网络处理器中灵活、动态的可重新配置处理路径
批准号:
5450696
负责人:
Professor Dr. Andreas Herkersdorf
金额:
$0.0万
依托单位国家:
德国
项目类别:
Research Grants
财政年份:
2005
资助国家:
德国
项目状态:
已结题
起止时间:
2004-12-31 至 2009-12-31

项目摘要

项目成果

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中文摘要
翻译
FlexPath是一种新型的netzwerkprozkarchitekturr,可动态重构verarbeitungspolehandenprozessorresource - effizienter nutzt and insgesametine höhere系统重构beritstellt。在der zurklecliegenden ersten项目中,phase wurde das FlexPath Konzept mitteles系统仿真验证,其中组件ententenen entwickelt和inen ersten FPGA原型测试。Messungen bestätigten基于FlexPath-spezifischen Verbesserungen hinsichtlich Paketdurchsatz和端到端Latenz的模具分析与仿真。Schwerpunkte der kommenden项目阶段与die Erweiterung基于FlexPath架构的多prozesssoc, die Entwicklung effizienter方法与die lastbalance ancierung基于Ausnutzung des Prinzips的dynamischer Verarbeitungspfade和die particle dynamicreconfiguration基于标准CPU prozessorresourcengegen dedizierte HW Beschleuniger内部halb基于MPSoC。Ferner sollen die vorz<e:1> von dynamisch rekonfigureerbaren Verarbeitungspfaden beder Anbindung eines externen Crypto-Co-Prozessors (DynaCore der Arbeitsgruppe Maehle, l<s:1>贝克)durch Aufbau eines gemeinsamen demonstration gezeigt werden。
英文摘要
FlexPath ist eine neue Netzwerkprozessor Architektur, die durch dynamisch rekonfigurierbare Verarbeitungspfade vorhandene Prozessorressourcen effizienter nutzt und insgesamt eine höhere Systemleistung bereitstellt. In der zurückliegenden ersten Projektphase wurde das FlexPath Konzept mittels Systemsimulation validiert, wichtige Komponenten entwickelt und in einen ersten FPGA Prototypen umgesetzt. Messungen bestätigten die analytisch und simulativ erwarteten FlexPath-spezifischen Verbesserungen hinsichtlich Paketdurchsatz und end-to-end Latenz. Schwerpunkte der kommenden Projektphase sind die Erweiterung der FlexPath Architektur auf ein Multi-Prozessor SoC, die Entwicklung effizienter Methoden zur Lastbalancierung unter Ausnutzung des Prinzips dynamischer Verarbeitungspfade und die partielle dynamische Rekonfiguration von Standard CPU Prozessorressourcen gegen dedizierte HW Beschleuniger innerhalb des MPSoC. Ferner sollen die Vorzüge von dynamisch rekonfigurierbaren Verarbeitungspfaden bei der Anbindung eines externen Crypto-Co-Prozessors (DynaCore der Arbeitsgruppe Maehle, Lübeck) durch Aufbau eines gemeinsamen Demonstrators gezeigt werden.
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会议论文
Architecture and Design Methodology for Autonomic Systems on Chip
  • 批准号:
    5454692
  • 项目类别:
    Priority Programmes
  • 资助金额:
    $0.0万
  • 财政年份:
    2005
  • 负责人:
    Professor Dr. Andreas Herkersdorf
  • 依托单位:
海外基金