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A Wide Tuning Range All-Digital Phase Locked Loop (AD PLL) in 65nm CMOS

A Wide Tuning Range All-Digital Phase Locked Loop (AD PLL) in 65nm CMOS
采用 65nm CMOS 的宽调谐范围全数字锁相环 (AD PLL)
批准号：
362834-2009
负责人：
Liao, Sabrina
金额：
$1.46万
依托单位：
Stanford University
依托单位国家：
加拿大
项目类别：
Postgraduate Scholarships - Master's
财政年份：
2009
资助国家：
加拿大
项目状态：
已结题
起止时间：
2009-01-01 至 2010-12-31
来源：
https://www.nserc-crsng.gc.ca/ase-oro/Details-Detailles_eng.asp?id=433686
关键词：
WideTuningRangeDigitalPhase

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SystemVerilog Modeling of Analog Circuits: A Method of Mixed-Signal SoC Validation
  • 批准号：
    420349-2012
  • 项目类别：
    Postgraduate Scholarships - Doctoral
  • 资助金额：
    $1.53万
  • 财政年份：
    2013
  • 负责人：
    Liao, Sabrina
  • 依托单位：
    Stanford University
SystemVerilog Modeling of Analog Circuits: A Method of Mixed-Signal SoC Validation
  • 批准号：
    420349-2012
  • 项目类别：
    Postgraduate Scholarships - Doctoral
  • 资助金额：
    $1.53万
  • 财政年份：
    2012
  • 负责人：
    Liao, Sabrina
  • 依托单位：
    Stanford University
A Wide Tuning Range All-Digital Phase Locked Loop (AD PLL) in 65nm CMOS
  • 批准号：
    362834-2008
  • 项目类别：
    Postgraduate Scholarships - Master's
  • 资助金额：
    $1.26万
  • 财政年份：
    2008
  • 负责人：
    Liao, Sabrina
  • 依托单位：
    Stanford University
Transmitter skew compensation for chip-to-chip buses
  • 批准号：
    352675-2007
  • 项目类别：
    University Undergraduate Student Research Awards
  • 资助金额：
    $0.33万
  • 财政年份：
    2007
  • 负责人：
    Liao, Sabrina
  • 依托单位：
    University of Toronto
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