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Methoden zur Verlustleistungsminimierung unter Ausnutzung von zellenbasierter Leistungsmodellierung und deren Anwendung zur Optimierung von anwendungsspezifischen Prozessorkernen

Methoden zur Verlustleistungsminimierung unter Ausnutzung von zellenbasierter Leistungsmodellierung und deren Anwendung zur Optimierung von anwendungsspezifischen Prozessorkernen
使用基于单元的功率建模来最小化功率损耗的方法及其用于优化特定应用处理器内核的应用
批准号:
5173370
负责人:
Professor Dr. Josef A. Nossek
金额:
$0.0万
依托单位国家:
德国
项目类别:
Priority Programmes
财政年份:
1999
资助国家:
德国
项目状态:
已结题
起止时间:
1998-12-31 至 2003-12-31

项目摘要

项目成果

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中文摘要
翻译
在沙尔通根的数字世界里,这是一种新的生活方式。在此基础上提出了一种解决问题的方法。Dazu Sollen die Eigenschaften der Basiszellen solcher Systeme be unterschiedlicher Beschaltung möglichst genaue ermittelt Wen den and Dann in Ein VHDLE-MODELL einflie?en en.在Zellbibliothek zusamengefaüt einer中的Schlie?lich Sollen diese Basiszellen,Wo bebejeder Basiszelle die spzifischen参数zugeordnet sind,die für die leistungsermittlung auf höherer Architekturebene Benötigt?在此基础上,我们将分析这一问题。MIT Hilfe Dieses es Sollen Dann verschiedene Architekturen von Schaltongen für DSP-Anwendungen Underden,inbebeondere die die-and Nachteile unterschiedlicher logikrealisierungen für bstimte Architekturen.在KomplexenDSPArchitekturen系统中,最优的Plzierung von Registein soll MIT Hilfe der Modelle Zur Minimierung der Verlustleistung in KomplexenDSPArchitekturen system atich unterstützt den.
英文摘要
Ziel des Projektes ist die Erarbeitung von Modellen zur Verlustleistungsbestimmung in digitalen Schaltungen. Mit der angestrebten Methode soll die schnelle Ermittlung der Verlustleistung komplexer Schaltungen ermöglicht werden. Dazu sollen die Eigenschaften der Basiszellen solcher Systeme bei unterschiedlicher Beschaltung möglichst genaue ermittelt werden und dann in ein VHDL-Modell einfließen. Schließlich sollen diese Basiszellen in einer Zellbibliothek zusammengefaßt werden, wobei jeder Basiszelle die spezifischen Parameter zugeordnet sind, die für die Leistungsermittlung auf höherer Architekturebene benötigt werden. Basierend auf einer solchen Zellbibliothek soll dann auf höherer Architekturebene eine genaue Verlustleistungsanalyse möglich sein. Mit Hilfe dieses Werkzeuges sollen dann verschiedene Architekturen von Schaltungen für DSP-Anwendungen untersucht werden, insbesondere die Vor- und Nachteile unterschiedlicher Logikrealisierungen für bestimmte Architekturen. Die optimale Plazierung von Registern soll mit Hilfe der Modelle zur Minimierung der Verlustleistung in komplexeren DSPArchitekturen systematisch unterstützt werden.
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海外基金
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  • 批准号:
    31700052
  • 项目类别:
    青年科学基金项目
  • 资助金额:
    22.0万元
  • 批准年份:
    2017
  • 负责人:
    明振华
  • 依托单位: