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Research on programming model for Reconfigurable Systems

可重构系统编程模型研究

基本信息

批准号：
23650018
负责人：
IIDA Masahiro
金额：
$ 1.58万
依托单位：
Kumamoto University
依托单位国家：
日本
项目类别：
Grant-in-Aid for Challenging Exploratory Research
财政年份：
2011
资助国家：
日本
起止时间：
2011 至 2013
项目状态：
已结题

项目摘要

In embedded systems, the need for rapid low-cost development has been increasing recently. Reuse of design assets is thus an important technique in embedded systems. However, reusability is generally low in software that has been specialized for a particular execution environment. This study proposes a software acceleration technique that is able to maintain software reusability. The proposed technique accelerates the software processing speed by employing dynamic data path generation from the software execution code. In the results of our work, the execution time of most internal loops was decreased by an average of 38.0% and a maximum of 42.3%. This result indicates the possibility that our proposed acceleration technique may promote software reusability while increasing software processing speed.

在嵌入式系统中，对快速低成本开发的需求日益增加。因此，设计资产的重用是嵌入式系统中的一项重要技术。然而，对于专门用于特定执行环境的软件，可重用性通常较低。本研究提出了一种能够保持软件可重用性的软件加速技术。该技术通过从软件执行代码中生成动态数据路径，加快了软件处理速度。在我们的工作结果中，大多数内部循环的执行时间平均减少了38.0%，最大减少了42.3%。这一结果表明，我们提出的加速技术可能在提高软件处理速度的同时促进软件的可重用性。

项目成果

期刊论文数量（0）

专著数量（0）

科研奖励数量（0）

会议论文数量（0）

专利数量（0）

組込みシステムを対象としたリコンフィギャラブルJavaアクセラレータの一検討

嵌入式系统可重构Java加速器的研究

DOI：
发表时间：
2012
期刊：
信学技報RECONF2012-48
影响因子：
0
作者：
高田誠也;尼崎太樹;飯田全広;久我守弘;末吉敏則
通讯作者：
末吉敏則

スケールフリーネットワークに基づくFPGA配線構造の基礎的検討

基于无标度网络的FPGA布线结构基础研究

DOI：
发表时间：
2012
期刊：
影响因子：
0
作者：
久米出;中村匡秀;新田直也;柴山悦哉;早馬悟司，尼崎太樹，飯田全広，久我守弘，末吉敏則
通讯作者：
早馬悟司，尼崎太樹，飯田全広，久我守弘，末吉敏則

A reconfigurable Java accelerator with software compatibility for embedded systems

具有嵌入式系统软件兼容性的可重新配置 Java 加速器

DOI：
发表时间：
2013
期刊：
Proc. International Workshop on Highly-Efficient Accelerators and Reconfigurable Technologies (HEART2013)
影响因子：
0
作者：
Y. Ogawa;M. Iida;M. Amagasaki;M. Kuga and T. Sueyoshi
通讯作者：
M. Kuga and T. Sueyoshi

仮想CGRAへのJavaソフトウェアのマッピングとFPGA実装

Java 软件映射到虚拟 CGRA 和 FPGA 实现