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A study of LSI design method with balance security and testability

A study of LSI design method with balance security and testability
平衡安全性与可测试性的LSI设计方法研究
批准号：
20700050
负责人：
YOSHIMURA Masayoshi
金额：
$2.58万
依托单位：
Kyushu University
依托单位国家：
日本
项目类别：
Grant-in-Aid for Young Scientists (B)
财政年份：
2008
资助国家：
日本
项目状态：
已结题
起止时间：
2008 至 2010
来源：
https://kaken.nii.ac.jp/grant/KAKENHI-PROJECT-20700050/
关键词：
VLSI設計技術設計自動化ディペンダブルコンピューティング暗号・認証等テスト容易化設計システム安全ディペンダブル・コンピユーフィングシステムLSI安全性ディペンダブル・コンピューティング

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It is difficult to balance with security and testability of LSIs.We showed factors which destroy security of LSIs. DFT (design for testability) techniques which increase testability and do not decrease security were proposed. A LSI design method was constructed by techniques. This method is applied to three cipher LSIs. Experimental results show three cipher LSIs have security and testability.
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会议论文
キャプチャ時低消費電力指向テスト生成における検出疑似外部出力決定法
捕获期间面向低功耗的测试生成的检测伪外部输出确定方法
DOI： --
发表时间： 2010
期刊：
影响因子： --
作者： [沈揚, et al]
通讯作者： et al
順序回路のソフトエラー耐性評価手法の高速化
时序电路软错误容错加速评估方法
DOI： --
发表时间： 2010
期刊：
影响因子： --
作者： [吉村正義, et al]
通讯作者： et al
有限状態機械の分割に基づく定常状態確率の近似計算手法
基于有限状态机划分的稳态概率近似计算方法
DOI： --
发表时间： 2010
期刊：
影响因子： --
作者： [長谷川創, et al]
通讯作者： et al
順序回路のソフトエラー耐性評価手法の状態数削減による高速化
通过减少状态数加速时序电路软容错评估方法
DOI： --
发表时间： 2010
期刊：
影响因子： --
作者： [高田直樹, 滝沢努, 宮兆〓, 増田信之, 伊藤智義, 下馬場朋禄, Mostafa Mjidi, 赤峰悠介]
通讯作者： 赤峰悠介
共 44 条
    Study on LSI design technology to detect Trojan circuit inserted during manufacturing process
    • 批准号：
      15K00086
    • 项目类别：
      Grant-in-Aid for Scientific Research (C)
    • 资助金额：
      $2.83万
    • 财政年份：
      2015
    • 负责人：
      YOSHIMURA Masayoshi
    • 依托单位：
      Kyoto Sangyo University
    Study on LSI design methods for security and testability
    海外基金