Wavelet Based Nonlinear Companding Method for Analog Circuit Behavioral Modeling
基于小波的非线性压扩模拟电路行为建模方法
基本信息
- 批准号:0306298
- 负责人:
- 金额:--
- 依托单位:
- 依托单位国家:美国
- 项目类别:Continuing Grant
- 财政年份:2003
- 资助国家:美国
- 起止时间:2003-07-01 至 2007-12-31
- 项目状态:已结题
- 来源:
- 关键词:
项目摘要
As analog ICs have rapidly evolved from the relatively low complexity ofthe early days to the high sophistication of today, the need for more advanced behavioral modeling techniques has become increasingly urgent. The objective of this project is to investigate a wavelet based nonlinear companding method for the behavioral modeling of analog circuits, and further develops a simulator based on the obtained behavioral models for the analysis and design of PLL circuit, which is one of the most important circuits in today's RF and high-speed VLSI systems. A nonlinear companding method is proposed to regulate the singularity of the wavelets such that a "smooth" fitting can be achieved between the wavelets and the concerned circuit functions. Such an approach will even the model error distribution and significantly improves the simulation efficiency at the system level. This project opens a new research direction for the wavelet theory and application. The investigated nonlinear companding approach will make wavelet a more effective basis function for engineering application. It will lead to new method for analog circuit behavioral modeling and greatly improve the efficiency of today's CAD tools for the analysis of mixed-signal systems. Particularly, it will improve the efficiency of the design and analysis of PLL circuit which is one of the most challenge and timing consuming tasks in high performance RF and analog system design.
随着模拟集成电路从早期的相对较低的复杂性迅速发展到今天的高度复杂,对更先进的行为建模技术的需求变得越来越迫切。本课题的目标是研究一种基于小波的非线性压扩方法用于模拟电路的行为建模,并在此基础上开发一个用于分析和设计锁相环电路的仿真器。锁相环是当今射频和高速VLSI系统中最重要的电路之一。提出了一种非线性压扩方法来调节小波的奇异性,以实现小波与相关电路函数的“平滑”拟合。这种方法将使模型误差分布更加均匀,显著提高了系统级的仿真效率。该项目为小波理论和应用开辟了一个新的研究方向。所研究的非线性压扩方法将使小波成为一种更有效的工程应用基函数。这将为模拟电路行为建模带来新的方法,并极大地提高目前用于混合信号系统分析的CAD工具的效率。特别是在高性能射频和模拟系统设计中,锁相环电路的设计和分析是最具挑战性和最耗时的任务之一,它将提高设计和分析的效率。
项目成果
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