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Interrupt handling and dynamic scheduling for binary synthesis
二进制综合的中断处理和动态调度
基本信息
- 批准号：16K00088
- 负责人：
- 金额：$ 2.91万
- 依托单位：
- 依托单位国家：日本
- 项目类别：Grant-in-Aid for Scientific Research (C)
- 财政年份：2016
- 资助国家：日本
- 起止时间：2016-04-01 至 2019-03-31
- 项目状态：已结题
- 来源：
- 关键词：
项目摘要
项目成果
期刊论文数量（0）
专著数量（0）
科研奖励数量（0）
会议论文数量（0）
专利数量（0）
High-Level Synthesis of Side Channel Attack Resistant RSA Decryption Circuit
抗侧信道攻击的RSA解密电路的高级综合
- DOI：
- 发表时间：2018
- 期刊：
- 影响因子：0
- 作者：N. Osako;S. OTA;S. Yura;and N. Ishiura
- 通讯作者：and N. Ishiura
Extending Distributed Control for High-Level Synthesis beyond Borders of Dataflow Graphs
将分布式控制扩展到数据流图之外的高级综合
- DOI：
- 发表时间：2016
- 期刊：
- 影响因子：0
- 作者：大窄直樹;石浦菜岐佐;M. Shimizu and N. Ishiura
- 通讯作者：M. Shimizu and N. Ishiura
High-Level Synthesis of Embedded Systems Controller from Erlang
Erlang 嵌入式系统控制器的高级综合
- DOI：
- 发表时间：2016
- 期刊：
- 影响因子：0
- 作者：H. Takebayashi;N. Ishiura;K. Azuma;N. Yoshida;and H. Kanbara
- 通讯作者：and H. Kanbara
Synthesis of Full Hardware Implementation of RTOS-Based Systems
基于 RTOS 的系统的全硬件实现综合
- DOI：10.1109/rsp.2018.8631993
- 发表时间：2018
- 期刊：
- 影响因子：0
- 作者：Y. Oosako;N. Ishiura;H. Tomiyama;and H. Kanbara
- 通讯作者：and H. Kanbara
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Ishiura Nagisa其他文献
Exploration of Address Offsets of Basic Blocks for Cache Hit Ratio Improvement
基本块地址偏移提高缓存命中率的探索
- DOI：
- 发表时间：
2015 - 期刊：
- 影响因子：0
- 作者：
Goto Junya;Ishiura Nagisa - 通讯作者：
Ishiura Nagisa
Binary Synthesis from RISC-V Executables
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- DOI：
- 发表时间：
2020 - 期刊：
- 影响因子：0
- 作者：
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Ishiura Nagisa
Full Hardware Synthesis of FreeRTOS-Based Systems
基于 FreeRTOS 的系统的全硬件综合
- DOI：
- 发表时间：
2020 - 期刊：
- 影响因子：0
- 作者：
Nakano Wakako;Ishiura Nagisa;Tomiyama Hiroyuki;Kanbara Hiroyuki - 通讯作者：
Kanbara Hiroyuki
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Synthesis of Full Hardware Implementation of RTOS-Based Systems
基于 RTOS 的系统的全硬件实现综合
- 批准号：
19H04081 - 财政年份：2019
- 资助金额：
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- 资助金额：
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