Entwicklung effizienter und flexibler VLSI-Architekturen für die Kanaldecodierung in drahtlosen Multi-Gigabit-Kommunikationssystemen auf Basis von LDPC-Codes.

开发高效、灵活的 VLSI 架构,用于基于 LDPC 码的多千兆位无线通信系统中的信道解码。

基本信息

项目摘要

Die drahtlose Kommunikation hat unsere Informationsgesellschaft in der letzten Dekade fundamental verändert und wird sie auch im nächsten Jahrzehnt weiter prägen. Kanalcodierungsverfahren spielen in drahtlosen Kommunikationssystemen eine zentrale Rolle um deren Bandbreiteneffizienz zu erhöhen. Auf diesem Gebiet ist mit der Einführung von Turbo- und LDPC-Codes in den 90er Jahren ein Durchbruch erzielt worden. Allerdings erfordert die Decodierung dieser Codes komplexe iterative Algorithmen, die eine hohe Implementierungskomplexität aufweisen. Wissenschaftliches Ziel dieses Antrages ist deshalb die Erforschung effizienter Kanalcodes, entsprechender Decodieralgorithmen und Architekturen auf der Basis von LDPC-Codes mit folgenden Eigenschaften: die Codes und entsprechenden Decodieralgorithmen sollen eine hohe nachrichtentechnische Performanz besitzen, aber gleichzeitig eine geringe Implementierungskomplexität der Decoderarchitekturen ermöglichen. Die resultierenden Durchsatzraten für State-of-the-Art CMOS Technologien sollen im Multi- Gigabit Bereich liegen. Die Decoderarchitekturen sollen eine hohe Energieeffizienz aufweisen, für verschiedene Dienste skalierbar und adaptierbar sein und weiterhin Robustheitsaspekte in zukünftigen VLSI Technologien berücksichtigen.
10年10月10日基础信息通信(以下简称“信息通信”)verändert和10年10月1日基础信息通信(以下简称“通信”)nächsten Jahrzehnt weiter prägen。kanalcodierungsverfaren spielen在drahtlosen Kommunikationssystemen eine zentrale Rolle um deren Bandbreiteneffizienz zuerhöhen。[1][1][1][1][1][1][1][1][1][1][1]。译码器译码器复杂迭代算法,译码器译码器译码器译码器译码器。特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征特征最先进的CMOS技术被称为多千兆比特芯片。Die decoderarchitekekturen sollen eine, the energieeffizizenz aufweisen, r verschiedene Dienste skalierbar, and adaptierbar sein and weiterin robust .这是在zukftigen VLSI technology bercksichtigen中讨论的。

项目成果

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On Complexity, Energy- and Implementation-Efficiency of Channel Decoders
通道解码器的复杂性、能量和实现效率
  • DOI:
    10.1109/tcomm.2011.092011.100157
  • 发表时间:
    2011
  • 期刊:
  • 影响因子:
    8.3
  • 作者:
    F. Kienle;N. Wehn;H. Meyr
  • 通讯作者:
    H. Meyr
ASIC design of a Gbit/s LDPC decoder for iterative MIMO systems
用于迭代 MIMO 系统的 Gbit/s LDPC 解码器 ASIC 设计
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Professor Dr.-Ing. Norbert Wehn其他文献

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