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Study of a Reconfigurable Parallel Processor

Study of a Reconfigurable Parallel Processor
可重构并行处理器的研究
批准号:
62460129
负责人:
TOMITA Shinji
金额:
$3.71万
依托单位:
依托单位国家:
日本
项目类别:
Grant-in-Aid for General Scientific Research (B)
财政年份:
1987
资助国家:
日本
项目状态:
已结题
起止时间:
1987 至 1988

项目摘要

项目成果

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中文摘要
翻译
项目的主要成果如下:1.可重构互连网络的研究。选择纵横制网络以获得任意的互连拓扑。该网络允许用户将互连拓扑与给定算法相匹配。模块化的128×128交叉开关网络是通过以16×16矩阵形式排列256个相同的交叉开关LSI模块来实现的。提出了一种网络具有切换模式的方法,以防止在运行时发生任何争用。利用该方法,可以实现高速的处理器间通信。2.处理单元的开发。实现了可重构的存储体系结构。该体系结构允许将系统重构为松耦合或紧耦合的多处理器。3.可重构并行处理器的开发。处理器之间的消息传输采用流水线方式,以实现处理器间的高速通信。开发了采用上述体系结构的可重构并行处理器。研究了动态负载均衡方案。在紧耦合多处理机系统中,任务/线程模型是一种较好的并行处理模型。提出了一种处理器分配任务的负载均衡方案。通过使用该方案,可以在处理器之间分配系统中的负载,并且可以减少上下文切换时的开销。开发了一种允许用户有效地描述并行处理模型的高级程序设计语言及其语言处理器。
英文摘要
Main results in the project are as follows.1.Studies on reconfigurableinterconnection networks. A crossbar network is chosen to attain arbitrary interconnection topologies. The network allows users to match a interconnection topology to a given algorithm. The modular 128X128 crossbar network is implemented by arranging 256 identical 8X8 crossbar LSI-modules in a 16X16 matrix form. A method where the network has switching patterns is proposed to prevent any contention from occurring at run time. By employing the method, high-speedinter-processor communication can be attained.2.Development of processing elements. Reconfigurable memory architecture is implemented. The architecture allows the system to be reconfigured as a loosely coupled multiprocessor or a tightly coupled multiprocessor.3.Development of a reconfigurable parallel processor. Message transmission between processors is pipelined to attain high-speed inter-processor communication. A reconfigurable parallel processor which employs the above architecturesis developed.4. Studies on dynamic load balancing scheme. Task/thread-model is chosen as a good parallel processing model in a tightly coupled multiprocessor. A load balancing scheme where processor assign a task is proposed. By using the scheme, loads in the system can be distributed between processors, and overhead during context switching can be reduced. A high-level programming language which allows users to describe parallel processing models effectively and its language processor are developed.
期刊论文(25)
专著(0)
科研奖励(0)
会议论文
村上和彰: 九州大学大学院総合理工学研究科報告. 10. 337-343 (1988)
村上和明:九州大学研究生院理工学研究报告。10. 337-343 (1988)。
DOI: --
发表时间:
期刊:
影响因子: --
作者: []
通讯作者:
Shin-ichiro, Mori: "Inter-PE Communication Mechanism in the Reconfigurable Parallel Processor" IPSJ Parallel Processing Symp. JSPP'89. 130-137 (1989)
Shin-ichiro, Mori:“可重构并行处理器中的 PE 间通信机制” IPSJ 并行处理 Symp。
DOI: --
发表时间:
期刊:
影响因子: --
作者: []
通讯作者:
Kazauaki Murakami: Proc.IFIP Congress '89. (1989)
村上和明:Proc.IFIP 大会 89。
DOI: --
发表时间:
期刊:
影响因子: --
作者: []
通讯作者:
Kazuaki, Murakami: "The Kyushu University Reconfigurable Parallel Processor - Design Philosophy and Architecture -" Proc. IFIP Congress '89. (1989)
Kazuaki, Murakami:“九州大学可重构并行处理器 - 设计哲学和架构 -”Proc。
DOI: --
发表时间:
期刊:
影响因子: --
作者: []
通讯作者:
14
    Real-Time Sensable Simulation Systems
    • 批准号:
      16100001
    • 项目类别:
      Grant-in-Aid for Scientific Research (S)
    • 资助金额:
      $70.64万
    • 财政年份:
      2004
    • 负责人:
      TOMITA Shinji
    • 依托单位:
    Development of a network supercomputing environment with fine grain dynamic load distribution mechanism
    • 批准号:
      12558027
    • 项目类别:
      Grant-in-Aid for Scientific Research (B)
    • 资助金额:
      $8.06万
    • 财政年份:
      2000
    • 负责人:
      TOMITA Shinji
    • 依托单位:
    A Research of Register-less Architecture for Next Generation High Performance Processors
    • 批准号:
      12480072
    • 项目类别:
      Grant-in-Aid for Scientific Research (B)
    • 资助金额:
      $7.42万
    • 财政年份:
      2000
    • 负责人:
      TOMITA Shinji
    • 依托单位:
    The Architecture of a Next Gereration Hultimedia Server
    • 批准号:
      10558045
    • 项目类别:
      Grant-in-Aid for Scientific Research (B)
    • 资助金额:
      $8.13万
    • 财政年份:
      1998
    • 负责人:
      TOMITA Shinji
    • 依托单位:
    海外基金