3次元VLSIにおける大域的層割当てに基づく多層配線手法に関する研究

3D VLSI中基于全局层分配的多层布线方法研究

基本信息

  • 批准号:
    05780269
  • 负责人:
  • 金额:
    $ 0.51万
  • 依托单位:
  • 依托单位国家:
    日本
  • 项目类别:
    Grant-in-Aid for Encouragement of Young Scientists (A)
  • 财政年份:
    1993
  • 资助国家:
    日本
  • 起止时间:
    1993 至 无数据
  • 项目状态:
    已结题

项目摘要

本研究で得られた成果の概要を以下の1-3にまとめる。1.3次元配線領域に対する詳細配線手法の開発:ネットの端子が異なる層に散在する3次元配線領域に対しネットの集合を現在配線しているカラム以降に現れる端子がどの垂直層からでているかによってZ上昇ネット,Z直進ネット,Z下降ネットの3種類に分類し,カラムごとに高速に配線する3次元グリーディーチャネルル-タを開発した。更に従来手法との比較により性能評価を行った。実験の結果,従来手法に対し解の質を落とさずに計算時間を大幅に短縮することが可能となった。2.3次元多層配線結果を表示するグラフィック端末システムの開発:上述のル-タを開発するにあたり,現有のUNIXワークステーション(モノクロ)では表示することが難しい3次元多層配線結果を,イーサネットを通して接続されたパソコン上で高解像度カラー表示を行うグラフィック端末システムを開発した。本システムでは表示画面上でネットの検索などができる機能を持っている。3.3次元配線領域に対する概略配線手法の開発:3次元配線領域をグラフ表現するため,新たに3次元チャネルグラフを導入した。このチャネルグラフでは同一チャネル内でのネットの層間の移動を表すことができる。また3次元チャネルグラフを用いて大域的層割当てを行う概略配線アルゴリズを開発した。
The results of this study are summarized in paragraphs 1-3 below. 1.3 The development of detailed wiring methods in the field of dimensional wiring: the terminal of the terminal is divided into different layers, scattered in the field of three-dimensional wiring, the terminal of the terminal is divided into vertical layers, vertical layers, More information about the method and performance evaluation The result is that the quality of the solution is greatly reduced. 2.3 The development of multi-dimensional multi-layer wiring results: the above-mentioned development of the existing UNIX system (UNIX) is difficult to express the development of multi-dimensional multi-layer wiring results, the development of high-resolution multi-layer wiring results. This list indicates that the search function on the screen is maintained. 3.3 The development of approximate alignment methods in the field of dimensional alignment:3-dimensional alignment field, 3-dimensional alignment field, 3-dimensional The movement between layers within the same cycle is also described. The three-dimensional network is used to split the layer of the large domain.

项目成果

期刊论文数量(1)
专著数量(0)
科研奖励数量(0)
会议论文数量(0)
专利数量(0)
大村道郎: "VLSIレイアウト設計におけるグリーディール-タの3次元モデルへの拡張" 電子情報通信学会技術研究報告. VLD93‐8. 49-56 (1993)
Michio Omura:“VLSI 布局设计中 GREEDEAL 到 3D 模型的扩展”IEICE 技术报告 49-56 (1993)。
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